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ソニー: DRAMを積層した3層構造のスマートフォン向けCMOSイメージセンサーを開発
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投稿時間:2017-02-07 18:42
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DRAMを積層した3層構造のスマートフォン向けCMOSイメージセンサーを開発
DRAMを積層した3層構造により、1930万画素サイズで120分の1秒の高速読み出しを実現。
フルHD(1920×1080画素)サイズで、毎秒最大1,000フレームのスーパースローモーション動画の撮影を実現。
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